Error detection in signed digit arithmetic circuit with parity checker [adder example] / Cardarilli, G., Ottavi, M., Pontarelli, S., Re, M., Salsano, A.. - (2003), pp. 401-408. (18th IEEE International Symposium on Defect and Fault Tolerance in VLSI Systems ) [10.1109/DFTVS.2003.1250137].
Error detection in signed digit arithmetic circuit with parity checker [adder example]
Pontarelli S;
2003
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